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SN74LVC8T245-Q1

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車載向け、電圧レベル・シフト機能搭載、3 ステート出力、8 ビット・デュアル電源バス・トランシーバ

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SN74LVC8T245-Q1

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製品詳細

Technology family LVC Applications GPIO Bits (#) 8 High input voltage (min) (V) 1.08 High input voltage (max) (V) 5.5 Vout (min) (V) 1.65 Vout (max) (V) 5.5 Data rate (max) (Mbps) 200 IOH (max) (mA) -32 IOL (max) (mA) 32 Supply current (max) (µA) 25 Features Output enable, Overvoltage tolerant inputs, Partial power down (Ioff) Input type Standard CMOS Output type 3-State, Balanced CMOS, Push-Pull Rating Automotive Operating temperature range (°C) -40 to 125
Technology family LVC Applications GPIO Bits (#) 8 High input voltage (min) (V) 1.08 High input voltage (max) (V) 5.5 Vout (min) (V) 1.65 Vout (max) (V) 5.5 Data rate (max) (Mbps) 200 IOH (max) (mA) -32 IOL (max) (mA) 32 Supply current (max) (µA) 25 Features Output enable, Overvoltage tolerant inputs, Partial power down (Ioff) Input type Standard CMOS Output type 3-State, Balanced CMOS, Push-Pull Rating Automotive Operating temperature range (°C) -40 to 125
TSSOP (PW) 24 49.92 mm² 7.8 x 6.4
  • 制御入力の V IH/V IL レベルは V CCA 電圧基準
  • V CC 絶縁機能：いずれかの V CC 入力が GND レベルになると、すべてが高インピーダンス状態に移行
  • 完全に構成可能なデュアル・レール設計により、1.65V～5.5V の電源電圧の全範囲にわたって各ポートが動作可能
  • JESD 78、Class II 準拠で 100mA 超のラッチアップ性能
  • JESD 22 を上回る ESD 保護
    • 4000V、人体モデル (A114-A)
    • 100V、マシン・モデル (A115-A)
    • 1000V、デバイス帯電モデル (C101)
  • 制御入力の V IH/V IL レベルは V CCA 電圧基準
  • V CC 絶縁機能：いずれかの V CC 入力が GND レベルになると、すべてが高インピーダンス状態に移行
  • 完全に構成可能なデュアル・レール設計により、1.65V～5.5V の電源電圧の全範囲にわたって各ポートが動作可能
  • JESD 78、Class II 準拠で 100mA 超のラッチアップ性能
  • JESD 22 を上回る ESD 保護
    • 4000V、人体モデル (A114-A)
    • 100V、マシン・モデル (A115-A)
    • 1000V、デバイス帯電モデル (C101)

SN74LVC8T245-Q1 は、8 ビット非反転バス・トランシーバであり、双方向の電圧レベル変換を可能にする構成可能なデュアル電源レールを備えています。 SN74LVC8T245-Q1 は、V CCA および V CCB が 1.65V～5.5V に設定された状態で動作するよう最適化されています。A ポートは V CCA に追従するように設計されており、V CCA は 1.65V～5.5V の電源電圧に対応します。B ポートは V CCB に追従するように設計されており、V CCB は 1.65V～5.5V の電源電圧に対応します。このため、1.8V、2.5V、3.3V、5V の任意の電圧ノード間での自在な低電圧双方向変換が可能です。

SN74LVC8T245-Q1 は、2 つのデータ・バス間の非同期通信用に設計されています。方向制御 (DIR) 入力および出力イネ ーブル ( OE) 入力のロジック・レベルに応じて、 B ポート出力もしくは A ポート出力のいずれかがアクティブになるか、または、両方の出力ポートが高インピーダンス・モードになります。本デバイスは、B ポート出力がアクティブになった場合、A バスから B バスへデータを転送し、A ポート出力がアクティブになった場合、B バスから A バスへデータを転送します。A ポートと B ポートの入力回路はどちらも常にアクティブであるため、これらのポートには論理 HIGH または LOW レベルを印加して、I CC と I CCZ が過剰に流れないようにする必要があります。

このデバイスは、I off を使用する部分的パワーダウン・アプリケーション用の動作が完全に規定されています。I off 回路が出力をディセーブルにするため、電源切断時にデバイスに電流が逆流して損傷に至ることを回避できます。V CC 絶縁機能は、どちらかの V CC 入力が GND レベルになると、全ての出力を確実に高インピーダンス状態にします。電源オンまたは電源オフ時に高インピーダンス状態を確保するため、 OE はプルアップ抵抗経由で V CC に接続する必要があります。この抵抗の最小値は、ドライバの電流シンク能力によって決定されます。

SN74LVC8T245-Q1 は、制御ピン (DIR および OE) が V CCA から電源を供給されるように設計されています。

SN74LVC8T245-Q1 は、8 ビット非反転バス・トランシーバであり、双方向の電圧レベル変換を可能にする構成可能なデュアル電源レールを備えています。 SN74LVC8T245-Q1 は、V CCA および V CCB が 1.65V～5.5V に設定された状態で動作するよう最適化されています。A ポートは V CCA に追従するように設計されており、V CCA は 1.65V～5.5V の電源電圧に対応します。B ポートは V CCB に追従するように設計されており、V CCB は 1.65V～5.5V の電源電圧に対応します。このため、1.8V、2.5V、3.3V、5V の任意の電圧ノード間での自在な低電圧双方向変換が可能です。

SN74LVC8T245-Q1 は、2 つのデータ・バス間の非同期通信用に設計されています。方向制御 (DIR) 入力および出力イネ ーブル ( OE) 入力のロジック・レベルに応じて、 B ポート出力もしくは A ポート出力のいずれかがアクティブになるか、または、両方の出力ポートが高インピーダンス・モードになります。本デバイスは、B ポート出力がアクティブになった場合、A バスから B バスへデータを転送し、A ポート出力がアクティブになった場合、B バスから A バスへデータを転送します。A ポートと B ポートの入力回路はどちらも常にアクティブであるため、これらのポートには論理 HIGH または LOW レベルを印加して、I CC と I CCZ が過剰に流れないようにする必要があります。

このデバイスは、I off を使用する部分的パワーダウン・アプリケーション用の動作が完全に規定されています。I off 回路が出力をディセーブルにするため、電源切断時にデバイスに電流が逆流して損傷に至ることを回避できます。V CC 絶縁機能は、どちらかの V CC 入力が GND レベルになると、全ての出力を確実に高インピーダンス状態にします。電源オンまたは電源オフ時に高インピーダンス状態を確保するため、 OE はプルアップ抵抗経由で V CC に接続する必要があります。この抵抗の最小値は、ドライバの電流シンク能力によって決定されます。

SN74LVC8T245-Q1 は、制御ピン (DIR および OE) が V CCA から電源を供給されるように設計されています。
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技術資料

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* データシート SN74LVC8T245-Q1 車載用、8 ビット デュアル電源 バス・トランシーバ、構成可能電圧変換、3 ステート出力 データシート (Rev. A 翻訳版) PDF | HTML 英語版 (Rev.A) PDF | HTML 2023年 2月 2日
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アプリケーション・ノート Bus-Interface Devices With Output-Damping Resistors Or Reduced-Drive Outputs (Rev. A) 1997年 8月 1日
アプリケーション・ノート CMOS Power Consumption and CPD Calculation (Rev. B) 1997年 6月 1日
アプリケーション・ノート LVC Characterization Information 1996年 12月 1日
アプリケーション・ノート Input and Output Characteristics of Digital Integrated Circuits 1996年 10月 1日
アプリケーション・ノート Live Insertion 1996年 10月 1日
設計ガイド Low-Voltage Logic (LVC) Designer's Guide 1996年 9月 1日
アプリケーション・ノート Understanding Advanced Bus-Interface Products Design Guide 1996年 5月 1日

設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

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パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
TSSOP (PW) 24 Ultra Librarian
TI の評価品に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用原材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブの拠点
  • 組み立てを実施した拠点

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