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LMK5C33414A

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JESD204B/C 対応、BAW VCO (バルク弾性波電圧制御発振器) 搭載、3 個の DPLL (デジタル PLL)、3 個の APLL (アナログ PLL)、4 個の入力と 14 個の出力、ネ

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LMK5C33414A

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製品詳細

Function Clock network synchronizer Number of outputs 14 RMS jitter (fs) 47 Output frequency (min) (MHz) 0.000000000001 Output frequency (max) (MHz) 1250 Input type HCSL, LVCMOS, LVDS, LVPECL, XTAL Output type CML, LVCMOS, LVDS, LVPECL Supply voltage (min) (V) 3.135 Supply voltage (max) (V) 3.465 Features JESD204B Rating Catalog Operating temperature range (°C) -40 to 105 Number of input channels 4
Function Clock network synchronizer Number of outputs 14 RMS jitter (fs) 47 Output frequency (min) (MHz) 0.000000000001 Output frequency (max) (MHz) 1250 Input type HCSL, LVCMOS, LVDS, LVPECL, XTAL Output type CML, LVCMOS, LVDS, LVPECL Supply voltage (min) (V) 3.135 Supply voltage (max) (V) 3.465 Features JESD204B Rating Catalog Operating temperature range (°C) -40 to 105 Number of input channels 4
VQFN (RGC) 64 81 mm² 9 x 9
  • 超低ジッタ BAW VCO ベースのワイヤレス クロック
    • 42fs (標準値) / 60fs (最大値) の RMS ジッタ (491.52MHz 時)
    • 47fs (標準値) / 65fs (最大値) の RMS ジッタ (245.76MHz 時)

  • アナログ位相ロック ループ (APLL) と対になった 3 つの高性能デジタル位相ロック ループ (DPLL)

    • 1mHz～4kHz にプログラム可能な DPLL ループ帯域幅
    • 1ppt 未満の DCO 周波数調整ステップ サイズ
  • 4 差動またはシングルエンド DPLL 入力
    • 1Hz (1PPS)～800MHz の入力周波数
    • デジタル ホールドオーバーおよびヒットレス スイッチング
  • 14 の差動出力、プログラム可能な HSDS/LVPECL、LVDS、および HSCL 出力形式
    • 最大 18 の合計周波数出力 (OUT0_P/N、OUT1 P/N、GPIO1、GPIO2 の 6 つの LVCMOS 周波数出力と 12 の差動出力で構成した場合)
    • 1Hz (1PPS)～1250MHz の出力周波数、プログラム可能なスイングおよび同相範囲
    • PCIe Gen 1～6 準拠
  • I2C、3 線式 / 4 線式 SPI インターフェイス
  • 動作時周囲温度：-40℃～85℃
  • 超低ジッタ BAW VCO ベースのワイヤレス クロック
    • 42fs (標準値) / 60fs (最大値) の RMS ジッタ (491.52MHz 時)
    • 47fs (標準値) / 65fs (最大値) の RMS ジッタ (245.76MHz 時)

  • アナログ位相ロック ループ (APLL) と対になった 3 つの高性能デジタル位相ロック ループ (DPLL)

    • 1mHz～4kHz にプログラム可能な DPLL ループ帯域幅
    • 1ppt 未満の DCO 周波数調整ステップ サイズ
  • 4 差動またはシングルエンド DPLL 入力
    • 1Hz (1PPS)～800MHz の入力周波数
    • デジタル ホールドオーバーおよびヒットレス スイッチング
  • 14 の差動出力、プログラム可能な HSDS/LVPECL、LVDS、および HSCL 出力形式
    • 最大 18 の合計周波数出力 (OUT0_P/N、OUT1 P/N、GPIO1、GPIO2 の 6 つの LVCMOS 周波数出力と 12 の差動出力で構成した場合)
    • 1Hz (1PPS)～1250MHz の出力周波数、プログラム可能なスイングおよび同相範囲
    • PCIe Gen 1～6 準拠
  • I2C、3 線式 / 4 線式 SPI インターフェイス
  • 動作時周囲温度：-40℃～85℃

LMK5C33414A は、無線通信およびインフラ アプリケーションの厳しい要件を満たすように設計された高性能ネットワーク シンクロナイザおよびジッタ クリーナです。

ネットワーク シンクロナイザは、ヒットレス スイッチングとジッタ減衰を実現するために、プログラマブルなループ帯域幅、外部ループ フィルタ不要を特長とする 3 つの DPLL を内蔵しており、最大限の柔軟性と使いやすさを備えています。各 DPLL は、対になった APLL を DPLL リファレンス入力に位相固定します。

APLL3 は、テキサス・インスツルメンツ独自のバルク弾性波 (BAW) 技術を採用した超高性能 PLL を特長としており、DPLL の基準入力周波数にもジッタ特性にも無関係に、42fs (標準値) / 60fs (最大値) の RMS ジッタで 491.52MHz の出力クロックを生成できます。APLL2 および APLL1 には、2 番目または 3 番目の周波数ドメイン、同期ドメインのオプションがあります。

リファレンス検証回路は、DPLL 基準クロックを監視し、スイッチオーバー イベントを検出するとクロック間でヒットレス スイッチングを実行します。ゼロ遅延モード (ZDM) と位相キャンセルを有効にすることで、入力と出力の位相関係を制御できます。

本デバイスは、I2C または SPI インターフェイスを介して完全にプログラム可能です。オンボード EEPROM を使用して、システムの起動クロックをカスタマイズできます。また、このデバイスには出荷時デフォルトの ROM プロファイルもフォールバック オプションとして用意されています。

LMK5C33414A は、無線通信およびインフラ アプリケーションの厳しい要件を満たすように設計された高性能ネットワーク シンクロナイザおよびジッタ クリーナです。

ネットワーク シンクロナイザは、ヒットレス スイッチングとジッタ減衰を実現するために、プログラマブルなループ帯域幅、外部ループ フィルタ不要を特長とする 3 つの DPLL を内蔵しており、最大限の柔軟性と使いやすさを備えています。各 DPLL は、対になった APLL を DPLL リファレンス入力に位相固定します。

APLL3 は、テキサス・インスツルメンツ独自のバルク弾性波 (BAW) 技術を採用した超高性能 PLL を特長としており、DPLL の基準入力周波数にもジッタ特性にも無関係に、42fs (標準値) / 60fs (最大値) の RMS ジッタで 491.52MHz の出力クロックを生成できます。APLL2 および APLL1 には、2 番目または 3 番目の周波数ドメイン、同期ドメインのオプションがあります。

リファレンス検証回路は、DPLL 基準クロックを監視し、スイッチオーバー イベントを検出するとクロック間でヒットレス スイッチングを実行します。ゼロ遅延モード (ZDM) と位相キャンセルを有効にすることで、入力と出力の位相関係を制御できます。

本デバイスは、I2C または SPI インターフェイスを介して完全にプログラム可能です。オンボード EEPROM を使用して、システムの起動クロックをカスタマイズできます。また、このデバイスには出荷時デフォルトの ROM プロファイルもフォールバック オプションとして用意されています。
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技術資料

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種類 タイトル 最新の英語版をダウンロード 日付
* データシート LMK5C33414A ネットワーク シンクロナイザ、 JED204B/JED204C および BAW VCO 付、ワイヤレス通信用 データシート PDF | HTML 英語版 PDF | HTML 2021年 3月 3日
EVM ユーザー ガイド (英語) LMK5C33414A Evaluation Module User's Guide PDF | HTML 2023年 12月 21日

設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

LMK5C33414AEVM — LMK5C33414A の評価基板

LMK5C33414A は、LMK5C33414A ネットワーク クロック ジェネレータ / シンクロナイザの評価基板 (EVM) です。この評価基板 (EVM) は、デバイスの評価、準拠試験、システムのプロトタイプ製作に使用できます。  LMK5C33414A は、3 個のアナログ PLL (APLL) と、ループ帯域幅がプログラマブルな 3 個のデジタル PLL (DPLL) を統合しています。この評価基板 (EVM) は、上記のデバイスと、50Ω の試験装置のインターフェイスを確立するために、クロック入力、発振器入力、クロック出力向けの SMA コネクタを複数搭載しています。TCXO (...)

ユーザー ガイド: PDF | HTML
TI.com で取り扱いなし
シミュレーション・モデル

LMK5B33216 Family IBIS model

SNAM295.ZIP (239 KB) - IBIS Model
ダウンロード
設計ツール

CLOCK-PERFDATA-DESIGN — Clock performance data and register settings for clock generators, network synchronizers, jitter cleaners, and other clocking devices.

Configuration, raw phase noise data, noise plots, and register data for common use cases on clock generators, network synchronizers, jitter cleaners, and other clocking devices
サポート対象の製品とハードウェア

サポート対象の製品とハードウェア

製品
クロック ネットワーク シンクロナイザ
LMK5B33216 — 2.5GHz のバルク弾性波発振器 (BAW VCO) を内蔵し 16 出力、3 個の DPLL と APLL (デジタルとアナログの PLL) を採用したネットワーク・シンクロナイザ LMK5B33414 — 2.5GHz のバルク弾性波発振器 (BAW VCO) を内蔵し 14 出力、3 個の DPLL と APLL (デジタルとアナログの PLL) を採用したネットワーク・シンクロナイザ LMK5C33414AS1 — BAW VCO (バルク弾性波電圧制御発振器) 搭載、IEEE-1588 対応、3 個の DPLL (デジタル PLL)、3 個の APLL (アナログ PLL)、4 個の入力と 14 個の出力、ネッ LMK5C33414A — JESD204B/C 対応、BAW VCO (バルク弾性波電圧制御発振器) 搭載、3 個の DPLL (デジタル PLL)、3 個の APLL (アナログ PLL)、4 個の入力と 14 個の出力、ネ LMK5C33216A — JESD204B/C 対応、BAW VCO (バルク弾性波電圧制御発振器) 搭載、3 個の DPLL (デジタル PLL)、3 個の APLL (アナログ PLL)、2 個の入力と 16 個の出力、ネ LMK5C33216AS1 — BAW VCO (バルク弾性波電圧制御発振器) 搭載、IEEE-1588 対応、3 個の DPLL (デジタル PLL)、3 個の APLL (アナログ PLL)、2 個の入力と 16 個の出力、ネッ
ソフトウェア
アプリケーション・ソフトウェアとフレームワーク
TICSPRO-SW — TICS (テキサス・インスツルメンツのクロックとシンセサイザ) Pro ソフトウェア
ダウンロードオプション
シミュレーション・ツール

PSPICE-FOR-TI — TI Design / シミュレーション・ツール向け PSpice®

PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル・ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。

設計とシミュレーション向けの環境である PSpice for TI (...)
リクエスト
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
VQFN (RGC) 64 Ultra Librarian
TI の評価品に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用原材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブの拠点
  • 組み立てを実施した拠点

サポートとトレーニング

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