SN74LV20A
- 2V~5.5V の VCC で動作
- 最大 tpd 6ns (5V 時)
- 標準 VOLP (出力グランド バウンス) < 0.8V (VCC = 3.3V、TA = 25℃)
- 標準 VOHV (出力 VOH アンダーシュート) > 2.3V (VCC = 3.3V、TA = 25℃)
- Ioff により部分的パワーダウン モードでの動作をサポート
- JESD 78、Class II 準拠で 100mA 超のラッチアップ性能
これらのデュアル 4 入力正論理 NAND ゲートは、2V~5.5V の VCC で動作するように設計されています。
技術資料
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1 をすべて表示 種類 | タイトル | 最新の英語版をダウンロード | 日付 | |||
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* | データシート | SN74LV20A デュアル 4 入力正論理 NAND ゲート データシート (Rev. F 翻訳版) | PDF | HTML | 英語版 (Rev.F) | PDF | HTML | 2024年 6月 26日 |
設計および開発
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評価ボード
14-24-LOGIC-EVM — 14 ピンから 24 ピンの D、DB、DGV、DW、DYY、NS、PW の各パッケージに封止した各種ロジック製品向けの汎用評価基板
14-24-logic-EVM 評価基板は、14 ピンから 24 ピンの D、DW、DB、NS、PW、DYY、DGV の各パッケージに封止した各種ロジック デバイスをサポートする設計を採用しています。
パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
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SOIC (D) | 14 | Ultra Librarian |
SOP (NS) | 14 | Ultra Librarian |
SSOP (DB) | 14 | Ultra Librarian |
TSSOP (PW) | 14 | Ultra Librarian |
TVSOP (DGV) | 14 | Ultra Librarian |
購入と品質
記載されている情報:
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL 定格 / ピーク リフロー
- MTBF/FIT 推定値
- 使用原材料
- 認定試験結果
- 継続的な信頼性モニタ試験結果
記載されている情報:
- ファブの拠点
- 組み立てを実施した拠点